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关键信号布线

关键信号布线的顺序:射频信号→中频、低频信号→时钟信号→高速信号。关键信号的布线应该遵循如下基本原则:

一、优先选择参考平面是地平面的信号层走线。

二、依照布局情况短布线。

三、走线间距单端线必须满足3W以上,差分线对间距必须满足20Mil以上。

四、走线少打过孔,优先在过孔Stub短的布线层布线。

京晓科技可提供2-60层PCB设计服务,对HDI盲埋孔、工控医疗类、高速通讯类,消费电子类,航空航天类,电源板,射频板有丰富设计经验。阻抗设计,叠层设计,生产制造,EQ确认等问题,一对一全程服务。京晓科技致力于提供高性价比的PCB产品服务,打造从PCB设计、PCB生产到SMT贴片的一站式服务生态体。 PCB制板的正确布线策略。黄石打造PCB制版原理

在PCB出现之前,电路是通过点到点的接线组成的。这种方法的可靠性很低,因为随着电路的老化,线路的破裂会导致线路节点的断路或者短路。绕线技术是电路技术的一个重大进步,这种方法通过将小口径线材绕在连接点的柱子上,提升了线路的耐久性以及可更换性。当电子行业从真空管、继电器发展到硅半导体以及集成电路的时候,电子元器件的尺寸和价格也在下降。电子产品越来越频繁的出现在了消费领域,促使厂商去寻找更小以及性价比更高的方案。于是,PCB诞生了。宜昌PCB制版报价在插头手指上镀上一层要求厚度的镍/金层,使之更具有硬度和耐磨性。

SDRAM的PCB布局布线要求

1、对于数据信号,如果32bit位宽数据总线中的低16位数据信号挂接其它缓冲器的情况,SDRAM作为接收器即写进程时,首先要保证SDRAM接收端的信号完整性,将SDRAM芯片放置在信号链路的远端,对于地址及控制信号的也应该如此处理。

2、对于挂了多片SDRAM芯片和其它器件的情况,从信号完整性角度来考虑,SDRAM芯片集中紧凑布局。

3、源端匹配电阻应靠近输出管脚放置,退耦电容靠近器件电源管脚放置。

4、SDRAM的数据、地址线推荐采用菊花链布线线和远端分支方式布线,Stub线头短。

5、对于SDRAM总线,一般要对SDRAM的时钟、数据、地址及控制信号在源端要串联上33欧姆或47欧姆的电阻;数据线串阻的位置可以通过SI仿真确定。

6、对于时钟信号采用∏型(RCR)滤波,走在内层,保证3W间距。

7、对于时钟频率在50MHz以下时一般在时序上没有问题,走线短。

8、对于时钟频率在100MHz以上数据线需要保证3W间距。

9、对于电源的处理,SDRAM接口I/O供电电压多是3.3V,首先要保证SDRAM器件每个电源管脚有一个退耦电容,每个SDRAM芯片有一两个大的储能电容,退耦电容要靠近电源管脚放置,储能大电容要靠近SDRAM器件放置,注意电容扇出方式。

10、SDRAM的设计案列

差分走线及等长注意事项

1.阻抗匹配的情况下,间距越小越好

2.蛇状线<圆弧转角<45度转角<90度转角(等长危害程度)

蛇状线的危害比转角小一些,因此若空间许可,尽量用蛇状线代替转角, 来达成等长的目的。 

3. 圆弧转角<45 度转角<90 度转角(走线转角危害程度)

转角所造成的相位差,以 90 度转角大,45 度转角次之,圆滑转角小。

圆滑转角所产生的共模噪声比 90 度转角小。

4. 等长优先级大于间距 间距<长度

差分讯号不等长,会造成逻辑判断错误,而间距不固定对逻辑判断的影响,几乎是微乎其微。而阻抗方面,间距不固定虽然会有变化,但其变化通常10%以内,只相当于一个过孔的影响。至于EMI幅射干扰的增加,与抗干扰能力的下降,可在间距变化之处,用GNDFill技巧,并多打过孔直接连到MainGND,以减少EMI幅射干扰,以及被动干扰的机会[29-30]。如前述,差分讯号重要的就是要等长,因此若无法兼顾固定间距与等长,则需以等长为优先考虑。 用NaOH溶液除去抗电镀覆盖膜层使非线路铜层裸露出来。

Cadence中X-net的添加

1.打开PCB文件:

(1).首先X-net是添加在串阻和串容上的一个模型,使得做等长的时候电阻或电容两边的网络变成一个网络,添加方法如下:

1):找到串阻或者串容

2):在Analyze->Model assignment--点击ok->

点击后跳出界面:用鼠标直接点击需要添加的电阻或者电容;找到需要添加的器件之后点击创建模型creat model之后弹出小框点击ok--接下来弹出小框(在这里需要注意的是Value不能为零,如果是零欧姆的串阻请将参数改为任意数值)

点击--是--可以看到需要添加的串阻或串容后面出现--即X-net添加成功

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